一种ΔΣ型ADC的比较器失调后台校准方法及其电路

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一种ΔΣ型ADC的比较器失调后台校准方法及其电路
申请号:CN202511063357
申请日期:2025-07-31
公开号:CN121012513A
公开日期:2025-11-25
类型:发明专利
摘要
本发明提供一种ΔΣ型ADC的比较器失调后台校准方法及其电路,包括:对参考电平进行参考电平混洗,将混洗后的参考电平输入比较器阵列和串并转换器,输出多个周期的数字码;移动平均值确定步骤:根据多个周期的数字码,利用EWMA算法,确定多个周期的各比较器对应的移动平均值;计算所有比较器的多个周期的移动平均值的均值;根据各比较器的移动平均值和均值,确定相对失调信息;根据相对失调信息并行修调待校准比较器内的控制码,并返回移动平均值确定步骤,直到各比较器对应的移动平均值和均值满足预设条件,使复位信号和使能信号变为低电平,停止迭代,校准完成。减小了校准复杂度、功耗与面积,提升了ΔΣ型ADC的线性度和量化精度。
技术关键词
后台校准方法 数字码 周期 后台校准电路 移动平均算法 电平 转换器 二进制电流舵 开关阵列 指数 电阻 信号 模块 基准 复杂度 表达式 功耗
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